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いつか使うことになるだろうと思ってはいたのですが。
何を今頃になって、というようなものですが。
ようやく本気で、ＣＰＬＤと四つに取り組みます。
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［第１４４回］
●ＣＰＬＤロジアナ（３３）１６ＣＨ版
いままで説明をしてきましたＣＰＬＤロジアナは８チャンネルです。
ロジアナの機能としては８チャンネルというのはちょっと少ないかなという印象です。
それでも２現象オシロに比べれば４倍の能力ということになりますからこれはこれでもよいかと勝手に納得をしました。
実は当初は８チャンネル版とは別に１６チャンネル版も作るつもりでした。
それを現行の８チャンネル版の延長として考えるとメモリが８ビットですから１６チャンネルのデータは２回に分けてメモリに書き込まなければなりません。
そこのところでサンプリングクロックが落ちてしまいます。
単純に考えても１／２になってしまいます。
それはやっぱり面白くありません。
なんとかよい工夫はないものかと折に触れて思い出しては考えていました。
入力については１６チャンネル分必要ですがこれは当然のことです。
それをそのままメモリに書き込むことができればよいのですが…。
ＲＡＭ６２２５６のデータビットは８ビットです。
データビットが１６ビットのＲＡＭもあるようですが価格がとても合いません。
やっぱり無理か、と半ば諦めていたのですが。
なんだ、できるじゃないか。
簡単なことでした。
６２２５６を２個使って１個をＤ０〜Ｄ７に、もう１個をＤ８〜Ｄ１５に割り当てればよかったのでした。
なんてことだ。
やっぱり相当に頭が固くなっておりました。
そのようにすれば１６チャンネルのラッチデータを同時にＲＡＭに書き込むことができます。
しかしそれを読み出すときは？
そのときも１６ビット２バイトのデータを同時に読み出してＰＩＣに送る時点で２回に分けて送るようにすればなんとかなりそうです。
そのように考えて作ってしまったのが下の写真のボードです。
サンプリングクロックを１００ＭＨｚにアップしてテストするよりも前に作った基板ですので「２０ＭＨｚ」になっています。
毎度書いておりますように記事はリアルタイムではありません（そういうときもありますけれど）。
内容によっては２ヶ月も３ヶ月も前のことを書いていたりします。
この基板も今年１月の初めごろに作ったものです。
しかしハードはともかくとしてソフトについては８チャンネルと１６チャンネルでは大きく異なります。
現行の８チャンネル版についてあれこれ試したりしながらその裏で１６チャンネル版についてもプログラムの作成を進めてきました。
そのことだけに専念するわけにもいきませんでしたのでハードはできたもののただ横目で眺めているしかないときもありました。
それでも時折時間をみつけて少しずつ作業を進めてやっとなんとか動くようになったのはつい先日のことです。
さらにここ２〜３日は集中してプログラムの仕上げにあたったおかげでほぼ完成と言えるところまでできたと思います。
今回はその出来たてのプログラムを実行してテストをした結果を初公開いたします。
下は１６チャンネル版をテスト中の写真です。
写真右側は８チャンネルでもテストに使っているクロック発生回路基板です。
下はＷｉｎｄｏｗｓ７パソコンでの表示画面です。
サンプリングクロックは１００ＭＨｚです。
ＰＲＯＢＥ０〜ＰＲＯＢＥ１５にはクロック発生回路基板の出力を接続しています。
各プローブに接続しているクロック発生回路基板の出力信号の周波数とその周期を下に示します。
クロック発生回路基板の出力が足りませんのでＰＲＯＢＥ１３〜ＰＲＯＢＥ１５にはＰＲＯＢＥ０〜ＰＲＯＢＥ２と同じ出力をつないでいます。
ＰＲＯＢＥ０ ４ＭＨｚ（２５０ｎｓ）
ＰＲＯＢＥ１ ２ＭＨｚ（５００ｎｓ）
ＰＲＯＢＥ２ １ＭＨｚ（１μｓ）
ＰＲＯＢＥ３ ５００ＫＨｚ（２μｓ）
ＰＲＯＢＥ４ ２５０ＫＨｚ（４μｓ）
ＰＲＯＢＥ５ １２５ＫＨｚ（８μｓ）
ＰＲＯＢＥ６ ６２．５ＫＨｚ（１６μｓ）
ＰＲＯＢＥ７ ３１．２５ＫＨｚ（３２μｓ）
ＰＲＯＢＥ８ １５．６２５ＫＨｚ（６４μｓ）
ＰＲＯＢＥ９ ７．８１２５ＫＨｚ（１２８μｓ）
ＰＲＯＢＥ１０ ３．９０６２５ＫＨｚ（２５６μｓ）
ＰＲＯＢＥ１１ １．９５３１２５ＫＨｚ（５１２μｓ）
ＰＲＯＢＥ１２ ９７６．５６２５Ｈｚ（１０２４μｓ）
ＰＲＯＢＥ１３ ４ＭＨｚ（２５０ｎｓ）
ＰＲＯＢＥ１４ ２ＭＨｚ（５００ｎｓ）
ＰＲＯＢＥ１５ １ＭＨｚ（１μｓ）
サンプリング周波数が高いのでＰＲＯＢＥ６〜ＰＲＯＢＥ１２は波形の一部がただの水平な線としてしか表示されません。
またＰＲＯＢＥ２〜ＰＲＯＢＥ５も１周期の全体は表示されずその一部だけの表示になっています。
下はサンプリングクロック１０ＭＨｚで測定した波形です。
ＰＲＯＢＥ５でトリガをかけています。
サンプリング周波数を下げて１０ＭＨｚにしましたからＰＲＯＢＥ２（１ＭＨｚ、１μｓ）〜ＰＲＯＢＥ５（１２５ＫＨｚ、８μｓ）は１周期の全体の波形が表示されるようになりました。
逆にＰＲＯＢＥ０（４ＭＨｚ、２５０ｎｓ）はサンプリング周波数が１０ＭＨｚでは分解能が足りませんから少し乱れた波形になっています。
下はサンプリングクロック１ＭＨｚで測定した波形です。
ＰＲＯＢＥ８でトリガをかけています。
サンプリング周波数をさらに下げて１ＭＨｚにしましたからＰＲＯＢＥ６（６２．５ＫＨｚ、１６μｓ）〜ＰＲＯＢＥ８（１５．６２５ＫＨｚ、６４μｓ）は１周期の全体の波形が表示されるようになりました。
逆にＰＲＯＢＥ０〜ＰＲＯＢＥ２は測定できなくなりました。
ＰＲＯＢＥ３（５００ＫＨｚ）はサンプリングクロック１ＭＨｚでは１周期（２μｓ）に２回のサンプリングしかできません。
上の波形はちょうど同期がとれた波形になっています。
下はサンプリングクロック１００ＫＨｚで測定した波形です。
ＰＲＯＢＥ１０でトリガをかけています。
サンプリング周波数をさらに下げて１００ＫＨｚにしましたからＰＲＯＢＥ９（７．８１２５ＫＨｚ、１２８μｓ）〜ＰＲＯＢＥ１２（９７６．５６２５Ｈｚ、１０２４μｓ）は１周期の全体の波形が表示されるようになりました。
ＰＲＯＢＥ０〜ＰＲＯＢＥ３はサンプリング周波数（１００ＫＨｚ）に対して信号の周波数が高すぎるので測定できません。
ＰＲＯＢＥ４（２５０ＫＨｚ、４μｓ）〜ＰＲＯＢＥ７（３１．２５ＫＨｚ、３２μｓ）は１００ＫＨｚでは分解能が足りませんから乱れた波形になっています。
ＰＲＯＢＥ８（１５．６２５ＫＨｚ、６４μｓ）は１００ＫＨｚでは１周期に６回〜７回のサンプリングができますからなんとか実際に近い波形として表示されています。
下はサンプリングクロック１０ＫＨｚで測定した波形です。
ＰＲＯＢＥ１２でトリガをかけています。
サンプリング周波数をさらに下げて１０ＫＨｚにしましたからＰＲＯＢＥ１１（１．９５３１２５ＫＨｚ、５１２μｓ）とＰＲＯＢＥ１２（９７６．５６２５Ｈｚ、１０２４μｓ）は１周期の全体の波形が表示されていますがそのほかのほとんどの信号はサンプリング周波数（１０ＫＨｚ）が低すぎるので正しく測定できません。
ＰＲＯＢＥ１０（３．９０６２５ＫＨｚ（２５６μｓ）は１０ＫＨｚでは分解能が足りませんから乱れた波形になっています。
ＣＰＬＤ入門！［第１４４回］
２０２２．３．２０ｕｐｌｏａｄ
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