トランジスタで８０８０をつくってしまおうというまさにびっくり仰天、狂気のプロジェクトです！
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見事にできましたら、もちろんＴＫ－８０モニタを乗せて、それからＢＡＳＩＣ、ＣＰ／Ｍを走らせましょう！
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［第１７２回］
●ＰＩＣ－ＣＰＬＤロジアナを使ってみました
納期の迫った仕事をかかえているため、このところ落ち着いて記事を書くだけのゆとりがありません。
何日おきかの更新になってしまいます。
トランジスタ版ＣＰＵの作業もそれなりに進んでいるのですが、それを記事にまとめようとしますと、図版やら写真やらも用意する必要が出てくるため、なかなか思うに任せません。
多分今度の連休が過ぎるあたりからは、もう少し時間が取れるようになるかと思います。
気長なお付き合いをお願いいたします。
さて、前回は何回目かの試作を重ねてやっと出来上がってきたＣＰＵクロック回路基板にパーツを実装して、その出力波形をオシロスコープで観測している写真をお見せしました。
参考までに下に再掲します。
上側（ＣＨ１）がクロックＡ（２ＭＨｚ）で下側（ＣＨ２）がクロックＢ（１ＭＨｚ）です。
オシロスコープはノイズの状態なども詳しく観測することが出来るため強力な武器ですが、私の所有している２現象タイプでは、前回少し説明したようないくつかの信号を同時に見ることはできません。
そういう場合にはなんといってもロジアナが威力を発揮します。
そこでまだ試作段階ですが、何ヶ月も前にとりあえず動くところまで出来ていたＰＩＣ－ＣＰＬＤロジアナで、トランジスタＣＰＵクロック回路の出力信号を確認してみることにしました。
ＰＩＣ－ＣＰＬＤロジアナについては当連載記事と並行して紹介していますので、そちらも参照願います。
プログラムもまだ試作段階なので、サンプリングクロックも回線№も表示するところまでは出来ていません。
サンプリングクロックは２０ＭＨｚです。
縦のラインは１０サンプリング毎に表示しています。
ですから縦のラインの表示間隔は２ＭＨｚ（０．５μｓ）です。
ＣＰＵクロック回路のとりあえずの確認ということで、ちょっと手抜きの観測です。
ＣＰＵクロック回路基板の信号出力コネクタの信号配列と、ＰＩＣ－ＣＰＬＤロジアナの信号入力コネクタの信号配列がなんとか一致するところがありましたので、それに合わせてフラットケーブルで直接接続しました。
そのためクロックの並び順が一般的な表示とは逆になっています。
一番上がクロックＥ（１２５ＫＨｚ）で、その下がクロックＥのＨ／Ｌが逆になったＥ＿です。
Ｑ出力に対するＱ＿出力です。
１２５ＫＨｚの１周期は８μｓです。
横方向の表示枠が狭くて１周期全部の表示ができません。
なんとか１周期の半分を見ることができます。
ちょうど縦ライン８本分です。
０．５μｓ×８＝４μｓですから計算通りになっています。
その下はクロックＤ（２５０ＫＨｚ）とクロックＤ＿です。
こちらの１周期は４μｓです。
計算通りです。
その下はクロックＣ（５００ＫＨｚ）とクロックＣ＿です。
１周期は２μｓです。
これも計算通りです。
そして最後の２本はクロックＢ（１ＭＨｚ）とクロックＢ＿です。
１周期は１μｓです。
これも計算通りです。
手抜きのコネクタ接続のため、クロックＡは表示できていませんが、クロックＡはオシロスコープで確認済みですから、まあよいでしょう。
ところで上の表示ウインドウの下部にスクロールバーが表示されていることにお気付きでしょうか。
そうなんです。
データ量に合わせて水平スクロール表示もできるのです。
こういう機能がＧＵＩアプリケーションでは割と簡単にできてしまうので、ＧＵＩは不慣れなのですけれど、利用すべきところには使えるようになりたいものです。
最後までスクロールしてみました。
次回に続きます。
トランジスタでＣＰＵをつくろう！［第１７２回］
２０１９．１０．３０ｕｐｌｏａｄ
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