ＰＩＣＢＡＳＩＣコンパイラ
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まるでインタプリタ。でもコンパイラです。超カンタン超シンプルです。
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［第２４３回］



●ＰＩＣ１８Ｆ４５Ｋ５０（６）ＳＲ　Ｌａｔｃｈ（３）

前回はＳＦＲに対するＲＥＡＤ／ＷＲＩＴＥの小手調べとして／ＷＲ、／ＲＤコマンドを使ってＰＯＲＴＢに値を書き込んでそれを読み出すという簡単な操作テストをしました。
ＳＲ　Ｌａｔｃｈの動作確認をするためには同様の操作をすればよいはずです。
ＳＲＣＯＮ０とＳＲＣＯＮ１に必要な初期値をセットしたあとＳＲＩ端子に信号を入力してその結果ＳＲＱ端子とＳＲＮＱ端子がどのように変化するかを見るという動作テストです。

ところがＳＲＣＯＮ０とＳＲＣＯＮ１に値をセットしようとしたのですが。
現在のＰＩＣＢＡＳＩＣコンパイラの機能のままではそれはできないということに気が付きました。
ＰＩＣはなかなかに困ったＩＣなのです。
その問題はもう３年も前に［第４１回］で書いています。
そこではＡＮＳＥＬレジスタについて書いているのですが同じ問題がＳＲＣＯＮ０、ＳＲＣＯＮ１にも当てはまります。

／ＷＲと／ＲＤコマンドはＡｃｃｅｓｓ　Ｂａｎｋを利用しています。
Ａｃｃｅｓｓ　Ｂａｎｋについては［第４１回］で説明しています。
ＰＩＣ１８Ｆ４５Ｋ５０のＤａｔａメモリは０００〜７ＦＦの２ＫＢなのですがＰＩＣのレジスタアクセスは通常は下位アドレス８ビットのみで行ないます。
そのためＰＩＣ１８Ｆ４５Ｋ５０ではアクセスできるメモリ空間を２５６バイトごとに区切るバンク切換え方式や上位アドレスをそのための特殊なレジスタに設定するリニアアクセス方式を使います。
それには事前にそのための設定が必要になります。
またこのところ説明しておりますＳＦＲはそれよりも上位の０Ｆ５７〜０ＦＦＦに割り付けられています。

通常ユーザー用のデータレジスタとしてはアドレス０００から後ろに向かって割り当てていくのが作法なのですがその場合ユーザー用のデータレジスタとシステム用のＳＦＲとを同じメモリアドレス空間でアクセスすることができません。
ＰＩＣのプログラムではＰＯＲＴレジスタなどのＳＦＲは頻繁にアクセスしますしユーザー用のワークレジスタも同時にアクセスする場面が少なくありません。
つまりはユーザー用のデータメモリとＳＦＲは同時にアクセスできないことにはプログラムが複雑にならざるをえません。
それを簡単にするための簡便なひとつの方法としてアクセスできるデータアドレスを０００〜０５Ｆまでの範囲に限定してそれをアドレス００〜５Ｆに割り当て、アドレス６０〜ＦＦにはＳＦＲのＦ６０〜ＦＦＦを割り当てるという方法がＡｃｃｅｓｓ　Ｂａｎｋです。
そしてデフォルトではＡｃｃｅｓｓ　Ｂａｎｋ方式が指定されています。
そういうことなのですが［第４１回］で指摘しておりますようにＰＩＣ１８Ｆ４５Ｋ５０ではＳＦＲのＦ５７〜Ｆ５Ｆがはみ出してしまってＡｃｃｅｓｓ　Ｂａｎｋ方式ではアクセスすることができません。


［出典］Ｍｉｃｒｏｃｈｉｐ　ＴｅｃｈｎｏｌｏｇｙＩｎｃ．　ＰＩＣ１８Ｆ２Ｘ／４５Ｋ５０　Ｄａｔａｓｈｅｅｔ

ということで。
／ＲＤと／ＷＲの仕様を変更するためにＰＩＣＢＡＳＩＣシステムプログラムの一部を変更しました。
変更後の仕様では／ＲＤと／ＷＲでのアドレス指定は００〜５６はユーザーメモリエリアの０００〜００５６に対応し５７〜ＦＦはＳＦＲエリアのＦ５７〜ＦＦＦに対応します。
これでＳＲＣＯＮ０やＳＲＣＯＮ１に対しても／ＲＤ、／ＷＲコマンドが使えるようになりました。
で。
さっそく使ってみたのですが。
実際はうまく機能していたのですがこの時は思い違いをしてしまったためうまくいっていないと思い込んであれこれやらなくてもよいことをやってしまいました。
その時のログです。


上から１２行目で／ｗｒ　ＳＲＣＯＮ０，８Ｃを実行したあと／ｒｄ　ＳＲＣＯＮ０を実行してＳＲＣＯＮ０がその通りの値になっていることを確認しました。
そのあと／ｒｄ　ＰＯＲＴＡを実行してＰＯＲＴＡが［２０］になったことを確認しています。
これでよかったのです。
ＰＯＲＴＡのｂｉｔ４がＳＲＱでｂｉｔ５がＳＲＮＱですから［２０］はＱ＝０、Ｑ＿＝１ということでＲＳ　ＦＦがリセット状態になっているのですがここで私は何をとち狂ったのかＲＳ　ＦＦがセット状態だと思い違いをしてしまいました。
ここでとんでもない思い違いをしてしまったためあれこれよけいなことばかりやって結果としてこの時はまともなテストはできませんでした。
今あらためてこのログを見るとＳＲＣＯＮ０もＳＲＣＯＮ１もちゃんとまともに設定されています。
まともにセットされてないのは私の頭だったのでした。

次回に続きます。

ＰＩＣＢＡＳＩＣコンパイラ［第２４３回］
２０２６．６．２４　ｕｐｌｏａｄ

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